利索能及
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专利号: 2024227673790
专利类型:实用新型
专利状态:未下证
专利领域: 暂无
更新日期:2025-09-11
缴费截止日期: 暂无
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摘要:

权利要求书:

1.一种储能设备的逆变电路,其特征在于,

该储能设备的逆变电路包括:主储能模块,逆变模块,输出模块,工作状态检测模块,副储能控制模块,第一检测模块,第二检测模块和电能调节模块;

所述主储能模块,与所述电能调节模块连接,用于提供第一电能,将第一电能与电能调节模块传输的副储能控制模块提供的第二电能进行叠加处理并输出第三电能;

所述逆变模块,与所述主储能模块连接,用于对第一电能或第三电能进行逆变处理并输出交流电能;

所述输出模块,与所述逆变模块连接,用于将交流电能传输给连接的用电设备;

所述工作状态检测模块,与所述主储能模块连接,用于检测主储能模块的工作状态和设定定时时间,并在主储能模块停止供电时,定时输出第一控制信号;

所述副储能控制模块,与所述工作状态检测模块和逆变模块连接,用于接收第一控制信号并存储逆变模块残余的电能,提供第二电能;

所述第一检测模块,与所述主储能模块连接,用于对第一电能进行电压采样和设定低压阈值,在采样的信号小于低压阈值时,输出第一检测信号;

所述第二检测模块,与所述副储能控制模块连接,用于对第二电能进行电压采样,设定满电阈值和放电阈值,在采样信号大于满电阈值时,输出第二控制信号,在采样的信号大于放电阈值时,持续控制第二检测信号的输出;

所述电能调节模块,与所述第一检测模块、第二检测模块和副储能控制模块连接,用于在接收到第一检测信号和第二检测信号时,将第二电能传输给主储能模块并将第二电能与第一电能进行叠加处理。

2.根据权利要求1所述的一种储能设备的逆变电路,其特征在于,所述主储能模块包括主储能设备、第一电容和第一二极管;所述逆变模块包括第一逆变器;所述输出模块包括输出接口;

所述主储能设备的第一端连接第一二极管的阳极和第一电容的一端端,第一二极管的阴极连接第一逆变器的第一输入端,主储能设备的第二端连接电能调节模块,第一逆变器的第二端和第一电容的另一端均接地,第一逆变器的第三端和第四端分别连接输出接口的第一端和第二端。

3.根据权利要求2所述的一种储能设备的逆变电路,其特征在于,所述工作状态检测模块包括第三电阻、第四电阻、第五电阻、第二开关管、第二电容、第六电阻、第一反相器和第一逻辑芯片;

所述第三电阻的一端连接第一二极管的阳极和第二开关管的集电极,第三电阻的另一端连接第二开关管的基极和第一反相器的输入端并通过第四电阻连接第五电阻的一端,第二电容的一端和地端,第二开关管的发射极连接第五电阻的另一端和第二电容的另一端并通过第六电阻连接第一逻辑芯片的A端,第一反相器的输出端连接第一逻辑芯片的B端,第一逻辑芯片的Y端连接副储能控制模块。

4.根据权利要求3所述的一种储能设备的逆变电路,其特征在于,所述副储能控制模块包括第二二极管、第二功率管和副储能设备;

所述第二二极管的阳极连接第一二极管的阴极,第二二极管的阴极连接第二功率管的漏极,第二功率管的源极连接副储能设备的第一端、第二检测模块和电能调节模块,副储能设备的第二端接地,第二功率管的栅极连接第一逻辑芯片的Y端。

5.根据权利要求4所述的一种储能设备的逆变电路,其特征在于,所述第二检测模块包括第七电阻、第八电阻、第九电阻、第十电阻、第一电源、第一比较器、第三开关管和第十一电阻;

所述第七电阻的一端连接副储能设备的第一端,第七电阻的另一端连接第一比较器额的同相端并通过第八电阻接地,第一比较器的反相端连接第三开关管的集电极和第九电阻的一端并通过第十电阻连接第一电源,第三开关管的发射极通过第十一电阻连接第九电阻的另一端和地端,第三开关管的基极连接第一比较器的输出端和电能调节模块。

6.根据权利要求5所述的一种储能设备的逆变电路,其特征在于,所述电能调节模块包括第二逻辑芯片、第一功率管、第三功率管、第二电阻、第一电阻和第一开关管;

所述第二逻辑芯片的A端连接第一比较器的输出端,第二逻辑芯片的Y端连接第三功率管的栅极并通过第二电阻连接第一开关管的基极,第二逻辑芯片的B端连接第一检测模块,第三功率管的漏极连接副储能设备的第一端,第三功率管的源极连接主储能设备的第二端和第一功率管的漏极,第一功率管的栅极连接第一开关管的集电极并通过第一电阻连接主储能设备的第一端,第一功率管的源极和第一开关管的发射极均连接副储能设备的第二端。

7.根据权利要求6所述的一种储能设备的逆变电路,其特征在于,所述第一检测模块包括第十二电阻、第十三电阻、第十四电阻、第十五电阻和第二比较器;

所述第十二电阻的一端连接主储能设备的第一端并通过第十四电阻连接第二比较器的同相端和第十五电阻的一端,第二比较器的反相端连接第十二电阻的另一端并通过第十三电阻连接主储能设备的第二端和第十五电阻的另一端,第二比较器的输出端连接第二逻辑芯片的B端。